Geyser-2: The Second Prototype CPU with Fine-grained Run-time Power Gating

L. Zhao, D. Ikebuchi, Y. Saito, M. Kamata, N. Seki, Y. Kojima, H. Amano, S. Koyama, T. Hashida, Y. Umahashi, D. Masuda, K. Usami, K. Kimura, M. Namiki, S. Takeda, H. Nakamura, M. Kondo

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本文言語English
ページ(範囲)87-88
ジャーナル16th Asia and South Pacific Design Automation Conference (ASP-DAC) 2011
出版ステータスPublished - 2011 1 26

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